edastudy:tessent:tessent_occ

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--- edastudy:tessent:tessent_occ [2025/04/15 15:41] – [3. Parent mode] user01
+++ edastudy:tessent:tessent_occ [2025/04/15 16:01] (当前版本) – [3. Parent mode] user01
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 Parent-mode, 父OCC只做时钟function clk 与shift clk之间进行切换，不做OCC的pluse gateing(这部分由child-OCC来实现)
+tile parent mode OCC + child OCC, 类似于OCC复制
-parent-mode使用场景：
+**非SSN场景**\\
-  * 非SSN场景，parent mode OCC, 输出funtion clk & shift clk mux好后的时钟给child OCC， 可以节省一根shift clock线。对于相同时钟，且多个tile集成的系统可以用这种方式。一个parent OCC + 多个tile,减少在顶层单独收shift timing。
+top parent mode OCC + n个tile内部child OCC,无需单独shift clock连线到tile，tile内部也不用单独check shift timing \\
+如果多个top parent mode OCC(频率不同) + tile child OCC, function模式下不同频率时钟为异步关系，切换到shift模式下，全为shift时钟，scan register单chain存在skew，需要插入latch
+**SSN场景**\\
+shfit clock都是走tile内部(由SSH产生)，intest时不考虑tile与tile之间的shift clock skew差异，这时用标准OCC是最好的。
 ===== - Child OCC =====

edastudy/tessent/tessent_occ.1744702893.txt.gz · 最后更改: 2025/04/15 15:41 由 user01